募集終了 【Verilog】FPGA及びASICセキュリティ開発の求人・案件
こちらの案件は募集期間が終了しました
単価 
※消費税を含めた参画者にお渡しする金額です。
〜600,000円／月（収支シミュレーション）
契約形態
業務委託（フリーランス）
最寄り駅
府中（東京都）
- 職務内容
・セキュリティ開発に携わっていただきます。 ・主に下記作業をご担当いただきます。 -基本設計、詳細設計 ‐実装、テスト ‐運用、保守
- 求めるスキル
・Verilogを用いた実務経験 ・RTLコーティング経験
歓迎スキル・通信系の案件に携わった経験
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- 精算・お支払い
- 精算条件 標準となる稼働時間が定められている場合、その契約上、稼働時間が上限値を超過したり、反対に下限値を下回った場合には実際の作業時間に基づき標準となる委託料から増額または減額されることになります。
ここではこのような精算のある契約を「有」、精算のない契約については「無」と表記しています。
有
- 精算基準時間 標準となる稼働時間の上限値・下限値です。
業務委託案件の契約上、稼働時間が上限値を超過したり、下限値を下回った場合には実際の作業時間に基づき標準となる委託料から増額または減額されます。
140時間〜180時間
- 支払いサイト 報酬お支払いまでの期間です。基本、月末締め翌月15日払いの15日サイトをとっています。
※業務委託契約のみに適用
※参画する現場により変動する場合があります。
15日
- 精算条件
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担当者より
データ通信分野におけるシステム設計及びコンサルティング を行っている企業になります。 今回はセキュリティ開発をご担当していただきます。 基本的には現場での作業を想定しております。 プロジェクトは長期を想定しており、 中長期的に腰をすえての参画を希望される方にマッチします。 Verilogを用いた実務経験を活かしたい方には おすすめの案件となっております。